SAFE public projects git trees. - safe/jmp/linux-2.6/blob - drivers/gpu/drm/radeon/radeon.h

   1 /*
   2  * Copyright 2008 Advanced Micro Devices, Inc.
   3  * Copyright 2008 Red Hat Inc.
   4  * Copyright 2009 Jerome Glisse.
   5  *
   6  * Permission is hereby granted, free of charge, to any person obtaining a
   7  * copy of this software and associated documentation files (the "Software"),
   8  * to deal in the Software without restriction, including without limitation
   9  * the rights to use, copy, modify, merge, publish, distribute, sublicense,
  10  * and/or sell copies of the Software, and to permit persons to whom the
  11  * Software is furnished to do so, subject to the following conditions:
  12  *
  13  * The above copyright notice and this permission notice shall be included in
  14  * all copies or substantial portions of the Software.
  15  *
  16  * THE SOFTWARE IS PROVIDED "AS IS", WITHOUT WARRANTY OF ANY KIND, EXPRESS OR
  17  * IMPLIED, INCLUDING BUT NOT LIMITED TO THE WARRANTIES OF MERCHANTABILITY,
  18  * FITNESS FOR A PARTICULAR PURPOSE AND NONINFRINGEMENT.  IN NO EVENT SHALL
  19  * THE COPYRIGHT HOLDER(S) OR AUTHOR(S) BE LIABLE FOR ANY CLAIM, DAMAGES OR
  20  * OTHER LIABILITY, WHETHER IN AN ACTION OF CONTRACT, TORT OR OTHERWISE,
  21  * ARISING FROM, OUT OF OR IN CONNECTION WITH THE SOFTWARE OR THE USE OR
  22  * OTHER DEALINGS IN THE SOFTWARE.
  23  *
  24  * Authors: Dave Airlie
  25  *          Alex Deucher
  26  *          Jerome Glisse
  27  */
  28 #ifndef __RADEON_H__
  29 #define __RADEON_H__
  30
  31 #include "radeon_object.h"
  32
  33 /* TODO: Here are things that needs to be done :
  34  *      - surface allocator & initializer : (bit like scratch reg) should
  35  *        initialize HDP_ stuff on RS600, R600, R700 hw, well anythings
  36  *        related to surface
  37  *      - WB : write back stuff (do it bit like scratch reg things)
  38  *      - Vblank : look at Jesse's rework and what we should do
  39  *      - r600/r700: gart & cp
  40  *      - cs : clean cs ioctl use bitmap & things like that.
  41  *      - power management stuff
  42  *      - Barrier in gart code
  43  *      - Unmappabled vram ?
  44  *      - TESTING, TESTING, TESTING
  45  */
  46
  47 /* Initialization path:
  48  *  We expect that acceleration initialization might fail for various
  49  *  reasons even thought we work hard to make it works on most
  50  *  configurations. In order to still have a working userspace in such
  51  *  situation the init path must succeed up to the memory controller
  52  *  initialization point. Failure before this point are considered as
  53  *  fatal error. Here is the init callchain :
  54  *      radeon_device_init  perform common structure, mutex initialization
  55  *      asic_init           setup the GPU memory layout and perform all
  56  *                          one time initialization (failure in this
  57  *                          function are considered fatal)
  58  *      asic_startup        setup the GPU acceleration, in order to
  59  *                          follow guideline the first thing this
  60  *                          function should do is setting the GPU
  61  *                          memory controller (only MC setup failure
  62  *                          are considered as fatal)
  63  */
  64
  65 #include <asm/atomic.h>
  66 #include <linux/wait.h>
  67 #include <linux/list.h>
  68 #include <linux/kref.h>
  69
  70 #include "radeon_family.h"
  71 #include "radeon_mode.h"
  72 #include "radeon_reg.h"
  73
  74 /*
  75  * Modules parameters.
  76  */
  77 extern int radeon_no_wb;
  78 extern int radeon_modeset;
  79 extern int radeon_dynclks;
  80 extern int radeon_r4xx_atom;
  81 extern int radeon_agpmode;
  82 extern int radeon_vram_limit;
  83 extern int radeon_gart_size;
  84 extern int radeon_benchmarking;
  85 extern int radeon_testing;
  86 extern int radeon_connector_table;
  87 extern int radeon_tv;
  88
  89 /*
  90  * Copy from radeon_drv.h so we don't have to include both and have conflicting
  91  * symbol;
  92  */
  93 #define RADEON_MAX_USEC_TIMEOUT         100000  /* 100 ms */
  94 #define RADEON_IB_POOL_SIZE             16
  95 #define RADEON_DEBUGFS_MAX_NUM_FILES    32
  96 #define RADEONFB_CONN_LIMIT             4
  97 #define RADEON_BIOS_NUM_SCRATCH         8
  98
  99 /*
 100  * Errata workarounds.
 101  */
 102 enum radeon_pll_errata {
 103         CHIP_ERRATA_R300_CG             = 0x00000001,
 104         CHIP_ERRATA_PLL_DUMMYREADS      = 0x00000002,
 105         CHIP_ERRATA_PLL_DELAY           = 0x00000004
 106 };
 107
 108
 109 struct radeon_device;
 110
 111
 112 /*
 113  * BIOS.
 114  */
 115 bool radeon_get_bios(struct radeon_device *rdev);
 116
 117
 118 /*
 119  * Dummy page
 120  */
 121 struct radeon_dummy_page {
 122         struct page     *page;
 123         dma_addr_t      addr;
 124 };
 125 int radeon_dummy_page_init(struct radeon_device *rdev);
 126 void radeon_dummy_page_fini(struct radeon_device *rdev);
 127
 128
 129 /*
 130  * Clocks
 131  */
 132 struct radeon_clock {
 133         struct radeon_pll p1pll;
 134         struct radeon_pll p2pll;
 135         struct radeon_pll spll;
 136         struct radeon_pll mpll;
 137         /* 10 Khz units */
 138         uint32_t default_mclk;
 139         uint32_t default_sclk;
 140 };
 141
 142 /*
 143  * Power management
 144  */
 145 int radeon_pm_init(struct radeon_device *rdev);
 146
 147 /*
 148  * Fences.
 149  */
 150 struct radeon_fence_driver {
 151         uint32_t                        scratch_reg;
 152         atomic_t                        seq;
 153         uint32_t                        last_seq;
 154         unsigned long                   count_timeout;
 155         wait_queue_head_t               queue;
 156         rwlock_t                        lock;
 157         struct list_head                created;
 158         struct list_head                emited;
 159         struct list_head                signaled;
 160 };
 161
 162 struct radeon_fence {
 163         struct radeon_device            *rdev;
 164         struct kref                     kref;
 165         struct list_head                list;
 166         /* protected by radeon_fence.lock */
 167         uint32_t                        seq;
 168         unsigned long                   timeout;
 169         bool                            emited;
 170         bool                            signaled;
 171 };
 172
 173 int radeon_fence_driver_init(struct radeon_device *rdev);
 174 void radeon_fence_driver_fini(struct radeon_device *rdev);
 175 int radeon_fence_create(struct radeon_device *rdev, struct radeon_fence **fence);
 176 int radeon_fence_emit(struct radeon_device *rdev, struct radeon_fence *fence);
 177 void radeon_fence_process(struct radeon_device *rdev);
 178 bool radeon_fence_signaled(struct radeon_fence *fence);
 179 int radeon_fence_wait(struct radeon_fence *fence, bool interruptible);
 180 int radeon_fence_wait_next(struct radeon_device *rdev);
 181 int radeon_fence_wait_last(struct radeon_device *rdev);
 182 struct radeon_fence *radeon_fence_ref(struct radeon_fence *fence);
 183 void radeon_fence_unref(struct radeon_fence **fence);
 184
 185 /*
 186  * Tiling registers
 187  */
 188 struct radeon_surface_reg {
 189         struct radeon_object *robj;
 190 };
 191
 192 #define RADEON_GEM_MAX_SURFACES 8
 193
 194 /*
 195  * Radeon buffer.
 196  */
 197 struct radeon_object;
 198
 199 struct radeon_object_list {
 200         struct list_head        list;
 201         struct radeon_object    *robj;
 202         uint64_t                gpu_offset;
 203         unsigned                rdomain;
 204         unsigned                wdomain;
 205         uint32_t                tiling_flags;
 206 };
 207
 208 int radeon_object_init(struct radeon_device *rdev);
 209 void radeon_object_fini(struct radeon_device *rdev);
 210 int radeon_object_create(struct radeon_device *rdev,
 211                          struct drm_gem_object *gobj,
 212                          unsigned long size,
 213                          bool kernel,
 214                          uint32_t domain,
 215                          bool interruptible,
 216                          struct radeon_object **robj_ptr);
 217 int radeon_object_kmap(struct radeon_object *robj, void **ptr);
 218 void radeon_object_kunmap(struct radeon_object *robj);
 219 void radeon_object_unref(struct radeon_object **robj);
 220 int radeon_object_pin(struct radeon_object *robj, uint32_t domain,
 221                       uint64_t *gpu_addr);
 222 void radeon_object_unpin(struct radeon_object *robj);
 223 int radeon_object_wait(struct radeon_object *robj);
 224 int radeon_object_busy_domain(struct radeon_object *robj, uint32_t *cur_placement);
 225 int radeon_object_evict_vram(struct radeon_device *rdev);
 226 int radeon_object_mmap(struct radeon_object *robj, uint64_t *offset);
 227 void radeon_object_force_delete(struct radeon_device *rdev);
 228 void radeon_object_list_add_object(struct radeon_object_list *lobj,
 229                                    struct list_head *head);
 230 int radeon_object_list_validate(struct list_head *head, void *fence);
 231 void radeon_object_list_unvalidate(struct list_head *head);
 232 void radeon_object_list_clean(struct list_head *head);
 233 int radeon_object_fbdev_mmap(struct radeon_object *robj,
 234                              struct vm_area_struct *vma);
 235 unsigned long radeon_object_size(struct radeon_object *robj);
 236 void radeon_object_clear_surface_reg(struct radeon_object *robj);
 237 int radeon_object_check_tiling(struct radeon_object *robj, bool has_moved,
 238                                bool force_drop);
 239 void radeon_object_set_tiling_flags(struct radeon_object *robj,
 240                                     uint32_t tiling_flags, uint32_t pitch);
 241 void radeon_object_get_tiling_flags(struct radeon_object *robj, uint32_t *tiling_flags, uint32_t *pitch);
 242 void radeon_bo_move_notify(struct ttm_buffer_object *bo,
 243                            struct ttm_mem_reg *mem);
 244 void radeon_bo_fault_reserve_notify(struct ttm_buffer_object *bo);
 245 /*
 246  * GEM objects.
 247  */
 248 struct radeon_gem {
 249         struct list_head        objects;
 250 };
 251
 252 int radeon_gem_init(struct radeon_device *rdev);
 253 void radeon_gem_fini(struct radeon_device *rdev);
 254 int radeon_gem_object_create(struct radeon_device *rdev, int size,
 255                              int alignment, int initial_domain,
 256                              bool discardable, bool kernel,
 257                              bool interruptible,
 258                              struct drm_gem_object **obj);
 259 int radeon_gem_object_pin(struct drm_gem_object *obj, uint32_t pin_domain,
 260                           uint64_t *gpu_addr);
 261 void radeon_gem_object_unpin(struct drm_gem_object *obj);
 262
 263
 264 /*
 265  * GART structures, functions & helpers
 266  */
 267 struct radeon_mc;
 268
 269 struct radeon_gart_table_ram {
 270         volatile uint32_t               *ptr;
 271 };
 272
 273 struct radeon_gart_table_vram {
 274         struct radeon_object            *robj;
 275         volatile uint32_t               *ptr;
 276 };
 277
 278 union radeon_gart_table {
 279         struct radeon_gart_table_ram    ram;
 280         struct radeon_gart_table_vram   vram;
 281 };
 282
 283 #define RADEON_GPU_PAGE_SIZE 4096
 284
 285 struct radeon_gart {
 286         dma_addr_t                      table_addr;
 287         unsigned                        num_gpu_pages;
 288         unsigned                        num_cpu_pages;
 289         unsigned                        table_size;
 290         union radeon_gart_table         table;
 291         struct page                     **pages;
 292         dma_addr_t                      *pages_addr;
 293         bool                            ready;
 294 };
 295
 296 int radeon_gart_table_ram_alloc(struct radeon_device *rdev);
 297 void radeon_gart_table_ram_free(struct radeon_device *rdev);
 298 int radeon_gart_table_vram_alloc(struct radeon_device *rdev);
 299 void radeon_gart_table_vram_free(struct radeon_device *rdev);
 300 int radeon_gart_init(struct radeon_device *rdev);
 301 void radeon_gart_fini(struct radeon_device *rdev);
 302 void radeon_gart_unbind(struct radeon_device *rdev, unsigned offset,
 303                         int pages);
 304 int radeon_gart_bind(struct radeon_device *rdev, unsigned offset,
 305                      int pages, struct page **pagelist);
 306
 307
 308 /*
 309  * GPU MC structures, functions & helpers
 310  */
 311 struct radeon_mc {
 312         resource_size_t         aper_size;
 313         resource_size_t         aper_base;
 314         resource_size_t         agp_base;
 315         /* for some chips with <= 32MB we need to lie
 316          * about vram size near mc fb location */
 317         u64                     mc_vram_size;
 318         u64                     gtt_location;
 319         u64                     gtt_size;
 320         u64                     gtt_start;
 321         u64                     gtt_end;
 322         u64                     vram_location;
 323         u64                     vram_start;
 324         u64                     vram_end;
 325         unsigned                vram_width;
 326         u64                     real_vram_size;
 327         int                     vram_mtrr;
 328         bool                    vram_is_ddr;
 329 };
 330
 331 int radeon_mc_setup(struct radeon_device *rdev);
 332
 333
 334 /*
 335  * GPU scratch registers structures, functions & helpers
 336  */
 337 struct radeon_scratch {
 338         unsigned                num_reg;
 339         bool                    free[32];
 340         uint32_t                reg[32];
 341 };
 342
 343 int radeon_scratch_get(struct radeon_device *rdev, uint32_t *reg);
 344 void radeon_scratch_free(struct radeon_device *rdev, uint32_t reg);
 345
 346
 347 /*
 348  * IRQS.
 349  */
 350 struct radeon_irq {
 351         bool            installed;
 352         bool            sw_int;
 353         /* FIXME: use a define max crtc rather than hardcode it */
 354         bool            crtc_vblank_int[2];
 355 };
 356
 357 int radeon_irq_kms_init(struct radeon_device *rdev);
 358 void radeon_irq_kms_fini(struct radeon_device *rdev);
 359
 360
 361 /*
 362  * CP & ring.
 363  */
 364 struct radeon_ib {
 365         struct list_head        list;
 366         unsigned long           idx;
 367         uint64_t                gpu_addr;
 368         struct radeon_fence     *fence;
 369         uint32_t        *ptr;
 370         uint32_t                length_dw;
 371 };
 372
 373 /*
 374  * locking -
 375  * mutex protects scheduled_ibs, ready, alloc_bm
 376  */
 377 struct radeon_ib_pool {
 378         struct mutex            mutex;
 379         struct radeon_object    *robj;
 380         struct list_head        scheduled_ibs;
 381         struct radeon_ib        ibs[RADEON_IB_POOL_SIZE];
 382         bool                    ready;
 383         DECLARE_BITMAP(alloc_bm, RADEON_IB_POOL_SIZE);
 384 };
 385
 386 struct radeon_cp {
 387         struct radeon_object    *ring_obj;
 388         volatile uint32_t       *ring;
 389         unsigned                rptr;
 390         unsigned                wptr;
 391         unsigned                wptr_old;
 392         unsigned                ring_size;
 393         unsigned                ring_free_dw;
 394         int                     count_dw;
 395         uint64_t                gpu_addr;
 396         uint32_t                align_mask;
 397         uint32_t                ptr_mask;
 398         struct mutex            mutex;
 399         bool                    ready;
 400 };
 401
 402 /*
 403  * R6xx+ IH ring
 404  */
 405 struct r600_ih {
 406         struct radeon_object    *ring_obj;
 407         volatile uint32_t       *ring;
 408         unsigned                rptr;
 409         unsigned                wptr;
 410         unsigned                wptr_old;
 411         unsigned                ring_size;
 412         uint64_t                gpu_addr;
 413         uint32_t                align_mask;
 414         uint32_t                ptr_mask;
 415         spinlock_t              lock;
 416         bool                    enabled;
 417 };
 418
 419 struct r600_blit {
 420         struct radeon_object    *shader_obj;
 421         u64 shader_gpu_addr;
 422         u32 vs_offset, ps_offset;
 423         u32 state_offset;
 424         u32 state_len;
 425         u32 vb_used, vb_total;
 426         struct radeon_ib *vb_ib;
 427 };
 428
 429 int radeon_ib_get(struct radeon_device *rdev, struct radeon_ib **ib);
 430 void radeon_ib_free(struct radeon_device *rdev, struct radeon_ib **ib);
 431 int radeon_ib_schedule(struct radeon_device *rdev, struct radeon_ib *ib);
 432 int radeon_ib_pool_init(struct radeon_device *rdev);
 433 void radeon_ib_pool_fini(struct radeon_device *rdev);
 434 int radeon_ib_test(struct radeon_device *rdev);
 435 /* Ring access between begin & end cannot sleep */
 436 void radeon_ring_free_size(struct radeon_device *rdev);
 437 int radeon_ring_lock(struct radeon_device *rdev, unsigned ndw);
 438 void radeon_ring_unlock_commit(struct radeon_device *rdev);
 439 void radeon_ring_unlock_undo(struct radeon_device *rdev);
 440 int radeon_ring_test(struct radeon_device *rdev);
 441 int radeon_ring_init(struct radeon_device *rdev, unsigned ring_size);
 442 void radeon_ring_fini(struct radeon_device *rdev);
 443
 444
 445 /*
 446  * CS.
 447  */
 448 struct radeon_cs_reloc {
 449         struct drm_gem_object           *gobj;
 450         struct radeon_object            *robj;
 451         struct radeon_object_list       lobj;
 452         uint32_t                        handle;
 453         uint32_t                        flags;
 454 };
 455
 456 struct radeon_cs_chunk {
 457         uint32_t                chunk_id;
 458         uint32_t                length_dw;
 459         int kpage_idx[2];
 460         uint32_t                *kpage[2];
 461         uint32_t                *kdata;
 462         void __user *user_ptr;
 463         int last_copied_page;
 464         int last_page_index;
 465 };
 466
 467 struct radeon_cs_parser {
 468         struct radeon_device    *rdev;
 469         struct drm_file         *filp;
 470         /* chunks */
 471         unsigned                nchunks;
 472         struct radeon_cs_chunk  *chunks;
 473         uint64_t                *chunks_array;
 474         /* IB */
 475         unsigned                idx;
 476         /* relocations */
 477         unsigned                nrelocs;
 478         struct radeon_cs_reloc  *relocs;
 479         struct radeon_cs_reloc  **relocs_ptr;
 480         struct list_head        validated;
 481         /* indices of various chunks */
 482         int                     chunk_ib_idx;
 483         int                     chunk_relocs_idx;
 484         struct radeon_ib        *ib;
 485         void                    *track;
 486         unsigned                family;
 487         int parser_error;
 488 };
 489
 490 extern int radeon_cs_update_pages(struct radeon_cs_parser *p, int pg_idx);
 491 extern int radeon_cs_finish_pages(struct radeon_cs_parser *p);
 492
 493
 494 static inline u32 radeon_get_ib_value(struct radeon_cs_parser *p, int idx)
 495 {
 496         struct radeon_cs_chunk *ibc = &p->chunks[p->chunk_ib_idx];
 497         u32 pg_idx, pg_offset;
 498         u32 idx_value = 0;
 499         int new_page;
 500
 501         pg_idx = (idx * 4) / PAGE_SIZE;
 502         pg_offset = (idx * 4) % PAGE_SIZE;
 503
 504         if (ibc->kpage_idx[0] == pg_idx)
 505                 return ibc->kpage[0][pg_offset/4];
 506         if (ibc->kpage_idx[1] == pg_idx)
 507                 return ibc->kpage[1][pg_offset/4];
 508
 509         new_page = radeon_cs_update_pages(p, pg_idx);
 510         if (new_page < 0) {
 511                 p->parser_error = new_page;
 512                 return 0;
 513         }
 514
 515         idx_value = ibc->kpage[new_page][pg_offset/4];
 516         return idx_value;
 517 }
 518
 519 struct radeon_cs_packet {
 520         unsigned        idx;
 521         unsigned        type;
 522         unsigned        reg;
 523         unsigned        opcode;
 524         int             count;
 525         unsigned        one_reg_wr;
 526 };
 527
 528 typedef int (*radeon_packet0_check_t)(struct radeon_cs_parser *p,
 529                                       struct radeon_cs_packet *pkt,
 530                                       unsigned idx, unsigned reg);
 531 typedef int (*radeon_packet3_check_t)(struct radeon_cs_parser *p,
 532                                       struct radeon_cs_packet *pkt);
 533
 534
 535 /*
 536  * AGP
 537  */
 538 int radeon_agp_init(struct radeon_device *rdev);
 539 void radeon_agp_resume(struct radeon_device *rdev);
 540 void radeon_agp_fini(struct radeon_device *rdev);
 541
 542
 543 /*
 544  * Writeback
 545  */
 546 struct radeon_wb {
 547         struct radeon_object    *wb_obj;
 548         volatile uint32_t       *wb;
 549         uint64_t                gpu_addr;
 550 };
 551
 552 /**
 553  * struct radeon_pm - power management datas
 554  * @max_bandwidth:      maximum bandwidth the gpu has (MByte/s)
 555  * @igp_sideport_mclk:  sideport memory clock Mhz (rs690,rs740,rs780,rs880)
 556  * @igp_system_mclk:    system clock Mhz (rs690,rs740,rs780,rs880)
 557  * @igp_ht_link_clk:    ht link clock Mhz (rs690,rs740,rs780,rs880)
 558  * @igp_ht_link_width:  ht link width in bits (rs690,rs740,rs780,rs880)
 559  * @k8_bandwidth:       k8 bandwidth the gpu has (MByte/s) (IGP)
 560  * @sideport_bandwidth: sideport bandwidth the gpu has (MByte/s) (IGP)
 561  * @ht_bandwidth:       ht bandwidth the gpu has (MByte/s) (IGP)
 562  * @core_bandwidth:     core GPU bandwidth the gpu has (MByte/s) (IGP)
 563  * @sclk:               GPU clock Mhz (core bandwith depends of this clock)
 564  * @needed_bandwidth:   current bandwidth needs
 565  *
 566  * It keeps track of various data needed to take powermanagement decision.
 567  * Bandwith need is used to determine minimun clock of the GPU and memory.
 568  * Equation between gpu/memory clock and available bandwidth is hw dependent
 569  * (type of memory, bus size, efficiency, ...)
 570  */
 571 struct radeon_pm {
 572         fixed20_12              max_bandwidth;
 573         fixed20_12              igp_sideport_mclk;
 574         fixed20_12              igp_system_mclk;
 575         fixed20_12              igp_ht_link_clk;
 576         fixed20_12              igp_ht_link_width;
 577         fixed20_12              k8_bandwidth;
 578         fixed20_12              sideport_bandwidth;
 579         fixed20_12              ht_bandwidth;
 580         fixed20_12              core_bandwidth;
 581         fixed20_12              sclk;
 582         fixed20_12              needed_bandwidth;
 583 };
 584
 585
 586 /*
 587  * Benchmarking
 588  */
 589 void radeon_benchmark(struct radeon_device *rdev);
 590
 591
 592 /*
 593  * Testing
 594  */
 595 void radeon_test_moves(struct radeon_device *rdev);
 596
 597
 598 /*
 599  * Debugfs
 600  */
 601 int radeon_debugfs_add_files(struct radeon_device *rdev,
 602                              struct drm_info_list *files,
 603                              unsigned nfiles);
 604 int radeon_debugfs_fence_init(struct radeon_device *rdev);
 605 int r100_debugfs_rbbm_init(struct radeon_device *rdev);
 606 int r100_debugfs_cp_init(struct radeon_device *rdev);
 607
 608
 609 /*
 610  * ASIC specific functions.
 611  */
 612 struct radeon_asic {
 613         int (*init)(struct radeon_device *rdev);
 614         void (*fini)(struct radeon_device *rdev);
 615         int (*resume)(struct radeon_device *rdev);
 616         int (*suspend)(struct radeon_device *rdev);
 617         void (*vga_set_state)(struct radeon_device *rdev, bool state);
 618         int (*gpu_reset)(struct radeon_device *rdev);
 619         void (*gart_tlb_flush)(struct radeon_device *rdev);
 620         int (*gart_set_page)(struct radeon_device *rdev, int i, uint64_t addr);
 621         int (*cp_init)(struct radeon_device *rdev, unsigned ring_size);
 622         void (*cp_fini)(struct radeon_device *rdev);
 623         void (*cp_disable)(struct radeon_device *rdev);
 624         void (*cp_commit)(struct radeon_device *rdev);
 625         void (*ring_start)(struct radeon_device *rdev);
 626         int (*ring_test)(struct radeon_device *rdev);
 627         void (*ring_ib_execute)(struct radeon_device *rdev, struct radeon_ib *ib);
 628         int (*irq_set)(struct radeon_device *rdev);
 629         int (*irq_process)(struct radeon_device *rdev);
 630         u32 (*get_vblank_counter)(struct radeon_device *rdev, int crtc);
 631         void (*fence_ring_emit)(struct radeon_device *rdev, struct radeon_fence *fence);
 632         int (*cs_parse)(struct radeon_cs_parser *p);
 633         int (*copy_blit)(struct radeon_device *rdev,
 634                          uint64_t src_offset,
 635                          uint64_t dst_offset,
 636                          unsigned num_pages,
 637                          struct radeon_fence *fence);
 638         int (*copy_dma)(struct radeon_device *rdev,
 639                         uint64_t src_offset,
 640                         uint64_t dst_offset,
 641                         unsigned num_pages,
 642                         struct radeon_fence *fence);
 643         int (*copy)(struct radeon_device *rdev,
 644                     uint64_t src_offset,
 645                     uint64_t dst_offset,
 646                     unsigned num_pages,
 647                     struct radeon_fence *fence);
 648         uint32_t (*get_engine_clock)(struct radeon_device *rdev);
 649         void (*set_engine_clock)(struct radeon_device *rdev, uint32_t eng_clock);
 650         uint32_t (*get_memory_clock)(struct radeon_device *rdev);
 651         void (*set_memory_clock)(struct radeon_device *rdev, uint32_t mem_clock);
 652         void (*set_pcie_lanes)(struct radeon_device *rdev, int lanes);
 653         void (*set_clock_gating)(struct radeon_device *rdev, int enable);
 654         int (*set_surface_reg)(struct radeon_device *rdev, int reg,
 655                                uint32_t tiling_flags, uint32_t pitch,
 656                                uint32_t offset, uint32_t obj_size);
 657         int (*clear_surface_reg)(struct radeon_device *rdev, int reg);
 658         void (*bandwidth_update)(struct radeon_device *rdev);
 659         void (*hdp_flush)(struct radeon_device *rdev);
 660 };
 661
 662 /*
 663  * Asic structures
 664  */
 665 struct r100_asic {
 666         const unsigned  *reg_safe_bm;
 667         unsigned        reg_safe_bm_size;
 668 };
 669
 670 struct r300_asic {
 671         const unsigned  *reg_safe_bm;
 672         unsigned        reg_safe_bm_size;
 673 };
 674
 675 struct r600_asic {
 676         unsigned max_pipes;
 677         unsigned max_tile_pipes;
 678         unsigned max_simds;
 679         unsigned max_backends;
 680         unsigned max_gprs;
 681         unsigned max_threads;
 682         unsigned max_stack_entries;
 683         unsigned max_hw_contexts;
 684         unsigned max_gs_threads;
 685         unsigned sx_max_export_size;
 686         unsigned sx_max_export_pos_size;
 687         unsigned sx_max_export_smx_size;
 688         unsigned sq_num_cf_insts;
 689 };
 690
 691 struct rv770_asic {
 692         unsigned max_pipes;
 693         unsigned max_tile_pipes;
 694         unsigned max_simds;
 695         unsigned max_backends;
 696         unsigned max_gprs;
 697         unsigned max_threads;
 698         unsigned max_stack_entries;
 699         unsigned max_hw_contexts;
 700         unsigned max_gs_threads;
 701         unsigned sx_max_export_size;
 702         unsigned sx_max_export_pos_size;
 703         unsigned sx_max_export_smx_size;
 704         unsigned sq_num_cf_insts;
 705         unsigned sx_num_of_sets;
 706         unsigned sc_prim_fifo_size;
 707         unsigned sc_hiz_tile_fifo_size;
 708         unsigned sc_earlyz_tile_fifo_fize;
 709 };
 710
 711 union radeon_asic_config {
 712         struct r300_asic        r300;
 713         struct r100_asic        r100;
 714         struct r600_asic        r600;
 715         struct rv770_asic       rv770;
 716 };
 717
 718
 719 /*
 720  * IOCTL.
 721  */
 722 int radeon_gem_info_ioctl(struct drm_device *dev, void *data,
 723                           struct drm_file *filp);
 724 int radeon_gem_create_ioctl(struct drm_device *dev, void *data,
 725                             struct drm_file *filp);
 726 int radeon_gem_pin_ioctl(struct drm_device *dev, void *data,
 727                          struct drm_file *file_priv);
 728 int radeon_gem_unpin_ioctl(struct drm_device *dev, void *data,
 729                            struct drm_file *file_priv);
 730 int radeon_gem_pwrite_ioctl(struct drm_device *dev, void *data,
 731                             struct drm_file *file_priv);
 732 int radeon_gem_pread_ioctl(struct drm_device *dev, void *data,
 733                            struct drm_file *file_priv);
 734 int radeon_gem_set_domain_ioctl(struct drm_device *dev, void *data,
 735                                 struct drm_file *filp);
 736 int radeon_gem_mmap_ioctl(struct drm_device *dev, void *data,
 737                           struct drm_file *filp);
 738 int radeon_gem_busy_ioctl(struct drm_device *dev, void *data,
 739                           struct drm_file *filp);
 740 int radeon_gem_wait_idle_ioctl(struct drm_device *dev, void *data,
 741                               struct drm_file *filp);
 742 int radeon_cs_ioctl(struct drm_device *dev, void *data, struct drm_file *filp);
 743 int radeon_gem_set_tiling_ioctl(struct drm_device *dev, void *data,
 744                                 struct drm_file *filp);
 745 int radeon_gem_get_tiling_ioctl(struct drm_device *dev, void *data,
 746                                 struct drm_file *filp);
 747
 748
 749 /*
 750  * Core structure, functions and helpers.
 751  */
 752 typedef uint32_t (*radeon_rreg_t)(struct radeon_device*, uint32_t);
 753 typedef void (*radeon_wreg_t)(struct radeon_device*, uint32_t, uint32_t);
 754
 755 struct radeon_device {
 756         struct device                   *dev;
 757         struct drm_device               *ddev;
 758         struct pci_dev                  *pdev;
 759         /* ASIC */
 760         union radeon_asic_config        config;
 761         enum radeon_family              family;
 762         unsigned long                   flags;
 763         int                             usec_timeout;
 764         enum radeon_pll_errata          pll_errata;
 765         int                             num_gb_pipes;
 766         int                             num_z_pipes;
 767         int                             disp_priority;
 768         /* BIOS */
 769         uint8_t                         *bios;
 770         bool                            is_atom_bios;
 771         uint16_t                        bios_header_start;
 772         struct radeon_object            *stollen_vga_memory;
 773         struct fb_info                  *fbdev_info;
 774         struct radeon_object            *fbdev_robj;
 775         struct radeon_framebuffer       *fbdev_rfb;
 776         /* Register mmio */
 777         resource_size_t                 rmmio_base;
 778         resource_size_t                 rmmio_size;
 779         void                            *rmmio;
 780         radeon_rreg_t                   mc_rreg;
 781         radeon_wreg_t                   mc_wreg;
 782         radeon_rreg_t                   pll_rreg;
 783         radeon_wreg_t                   pll_wreg;
 784         uint32_t                        pcie_reg_mask;
 785         radeon_rreg_t                   pciep_rreg;
 786         radeon_wreg_t                   pciep_wreg;
 787         struct radeon_clock             clock;
 788         struct radeon_mc                mc;
 789         struct radeon_gart              gart;
 790         struct radeon_mode_info         mode_info;
 791         struct radeon_scratch           scratch;
 792         struct radeon_mman              mman;
 793         struct radeon_fence_driver      fence_drv;
 794         struct radeon_cp                cp;
 795         struct radeon_ib_pool           ib_pool;
 796         struct radeon_irq               irq;
 797         struct radeon_asic              *asic;
 798         struct radeon_gem               gem;
 799         struct radeon_pm                pm;
 800         uint32_t                        bios_scratch[RADEON_BIOS_NUM_SCRATCH];
 801         struct mutex                    cs_mutex;
 802         struct radeon_wb                wb;
 803         struct radeon_dummy_page        dummy_page;
 804         bool                            gpu_lockup;
 805         bool                            shutdown;
 806         bool                            suspend;
 807         bool                            need_dma32;
 808         bool                            accel_working;
 809         struct radeon_surface_reg surface_regs[RADEON_GEM_MAX_SURFACES];
 810         const struct firmware *me_fw;   /* all family ME firmware */
 811         const struct firmware *pfp_fw;  /* r6/700 PFP firmware */
 812         const struct firmware *rlc_fw;  /* r6/700 RLC firmware */
 813         struct r600_blit r600_blit;
 814         int msi_enabled; /* msi enabled */
 815         struct r600_ih ih; /* r6/700 interrupt ring */
 816 };
 817
 818 int radeon_device_init(struct radeon_device *rdev,
 819                        struct drm_device *ddev,
 820                        struct pci_dev *pdev,
 821                        uint32_t flags);
 822 void radeon_device_fini(struct radeon_device *rdev);
 823 int radeon_gpu_wait_for_idle(struct radeon_device *rdev);
 824
 825 /* r600 blit */
 826 int r600_blit_prepare_copy(struct radeon_device *rdev, int size_bytes);
 827 void r600_blit_done_copy(struct radeon_device *rdev, struct radeon_fence *fence);
 828 void r600_kms_blit_copy(struct radeon_device *rdev,
 829                         u64 src_gpu_addr, u64 dst_gpu_addr,
 830                         int size_bytes);
 831
 832 static inline uint32_t r100_mm_rreg(struct radeon_device *rdev, uint32_t reg)
 833 {
 834         if (reg < 0x10000)
 835                 return readl(((void __iomem *)rdev->rmmio) + reg);
 836         else {
 837                 writel(reg, ((void __iomem *)rdev->rmmio) + RADEON_MM_INDEX);
 838                 return readl(((void __iomem *)rdev->rmmio) + RADEON_MM_DATA);
 839         }
 840 }
 841
 842 static inline void r100_mm_wreg(struct radeon_device *rdev, uint32_t reg, uint32_t v)
 843 {
 844         if (reg < 0x10000)
 845                 writel(v, ((void __iomem *)rdev->rmmio) + reg);
 846         else {
 847                 writel(reg, ((void __iomem *)rdev->rmmio) + RADEON_MM_INDEX);
 848                 writel(v, ((void __iomem *)rdev->rmmio) + RADEON_MM_DATA);
 849         }
 850 }
 851
 852
 853 /*
 854  * Registers read & write functions.
 855  */
 856 #define RREG8(reg) readb(((void __iomem *)rdev->rmmio) + (reg))
 857 #define WREG8(reg, v) writeb(v, ((void __iomem *)rdev->rmmio) + (reg))
 858 #define RREG32(reg) r100_mm_rreg(rdev, (reg))
 859 #define DREG32(reg) printk(KERN_INFO "REGISTER: " #reg " : 0x%08X\n", r100_mm_rreg(rdev, (reg)))
 860 #define WREG32(reg, v) r100_mm_wreg(rdev, (reg), (v))
 861 #define REG_SET(FIELD, v) (((v) << FIELD##_SHIFT) & FIELD##_MASK)
 862 #define REG_GET(FIELD, v) (((v) << FIELD##_SHIFT) & FIELD##_MASK)
 863 #define RREG32_PLL(reg) rdev->pll_rreg(rdev, (reg))
 864 #define WREG32_PLL(reg, v) rdev->pll_wreg(rdev, (reg), (v))
 865 #define RREG32_MC(reg) rdev->mc_rreg(rdev, (reg))
 866 #define WREG32_MC(reg, v) rdev->mc_wreg(rdev, (reg), (v))
 867 #define RREG32_PCIE(reg) rv370_pcie_rreg(rdev, (reg))
 868 #define WREG32_PCIE(reg, v) rv370_pcie_wreg(rdev, (reg), (v))
 869 #define WREG32_P(reg, val, mask)                                \
 870         do {                                                    \
 871                 uint32_t tmp_ = RREG32(reg);                    \
 872                 tmp_ &= (mask);                                 \
 873                 tmp_ |= ((val) & ~(mask));                      \
 874                 WREG32(reg, tmp_);                              \
 875         } while (0)
 876 #define WREG32_PLL_P(reg, val, mask)                            \
 877         do {                                                    \
 878                 uint32_t tmp_ = RREG32_PLL(reg);                \
 879                 tmp_ &= (mask);                                 \
 880                 tmp_ |= ((val) & ~(mask));                      \
 881                 WREG32_PLL(reg, tmp_);                          \
 882         } while (0)
 883 #define DREG32_SYS(sqf, rdev, reg) seq_printf((sqf), #reg " : 0x%08X\n", r100_mm_rreg((rdev), (reg)))
 884
 885 /*
 886  * Indirect registers accessor
 887  */
 888 static inline uint32_t rv370_pcie_rreg(struct radeon_device *rdev, uint32_t reg)
 889 {
 890         uint32_t r;
 891
 892         WREG32(RADEON_PCIE_INDEX, ((reg) & rdev->pcie_reg_mask));
 893         r = RREG32(RADEON_PCIE_DATA);
 894         return r;
 895 }
 896
 897 static inline void rv370_pcie_wreg(struct radeon_device *rdev, uint32_t reg, uint32_t v)
 898 {
 899         WREG32(RADEON_PCIE_INDEX, ((reg) & rdev->pcie_reg_mask));
 900         WREG32(RADEON_PCIE_DATA, (v));
 901 }
 902
 903 void r100_pll_errata_after_index(struct radeon_device *rdev);
 904
 905
 906 /*
 907  * ASICs helpers.
 908  */
 909 #define ASIC_IS_RN50(rdev) ((rdev->pdev->device == 0x515e) || \
 910                             (rdev->pdev->device == 0x5969))
 911 #define ASIC_IS_RV100(rdev) ((rdev->family == CHIP_RV100) || \
 912                 (rdev->family == CHIP_RV200) || \
 913                 (rdev->family == CHIP_RS100) || \
 914                 (rdev->family == CHIP_RS200) || \
 915                 (rdev->family == CHIP_RV250) || \
 916                 (rdev->family == CHIP_RV280) || \
 917                 (rdev->family == CHIP_RS300))
 918 #define ASIC_IS_R300(rdev) ((rdev->family == CHIP_R300)  ||     \
 919                 (rdev->family == CHIP_RV350) ||                 \
 920                 (rdev->family == CHIP_R350)  ||                 \
 921                 (rdev->family == CHIP_RV380) ||                 \
 922                 (rdev->family == CHIP_R420)  ||                 \
 923                 (rdev->family == CHIP_R423)  ||                 \
 924                 (rdev->family == CHIP_RV410) ||                 \
 925                 (rdev->family == CHIP_RS400) ||                 \
 926                 (rdev->family == CHIP_RS480))
 927 #define ASIC_IS_AVIVO(rdev) ((rdev->family >= CHIP_RS600))
 928 #define ASIC_IS_DCE3(rdev) ((rdev->family >= CHIP_RV620))
 929 #define ASIC_IS_DCE32(rdev) ((rdev->family >= CHIP_RV730))
 930
 931
 932 /*
 933  * BIOS helpers.
 934  */
 935 #define RBIOS8(i) (rdev->bios[i])
 936 #define RBIOS16(i) (RBIOS8(i) | (RBIOS8((i)+1) << 8))
 937 #define RBIOS32(i) ((RBIOS16(i)) | (RBIOS16((i)+2) << 16))
 938
 939 int radeon_combios_init(struct radeon_device *rdev);
 940 void radeon_combios_fini(struct radeon_device *rdev);
 941 int radeon_atombios_init(struct radeon_device *rdev);
 942 void radeon_atombios_fini(struct radeon_device *rdev);
 943
 944
 945 /*
 946  * RING helpers.
 947  */
 948 static inline void radeon_ring_write(struct radeon_device *rdev, uint32_t v)
 949 {
 950 #if DRM_DEBUG_CODE
 951         if (rdev->cp.count_dw <= 0) {
 952                 DRM_ERROR("radeon: writting more dword to ring than expected !\n");
 953         }
 954 #endif
 955         rdev->cp.ring[rdev->cp.wptr++] = v;
 956         rdev->cp.wptr &= rdev->cp.ptr_mask;
 957         rdev->cp.count_dw--;
 958         rdev->cp.ring_free_dw--;
 959 }
 960
 961
 962 /*
 963  * ASICs macro.
 964  */
 965 #define radeon_init(rdev) (rdev)->asic->init((rdev))
 966 #define radeon_fini(rdev) (rdev)->asic->fini((rdev))
 967 #define radeon_resume(rdev) (rdev)->asic->resume((rdev))
 968 #define radeon_suspend(rdev) (rdev)->asic->suspend((rdev))
 969 #define radeon_cs_parse(p) rdev->asic->cs_parse((p))
 970 #define radeon_vga_set_state(rdev, state) (rdev)->asic->vga_set_state((rdev), (state))
 971 #define radeon_gpu_reset(rdev) (rdev)->asic->gpu_reset((rdev))
 972 #define radeon_gart_tlb_flush(rdev) (rdev)->asic->gart_tlb_flush((rdev))
 973 #define radeon_gart_set_page(rdev, i, p) (rdev)->asic->gart_set_page((rdev), (i), (p))
 974 #define radeon_cp_commit(rdev) (rdev)->asic->cp_commit((rdev))
 975 #define radeon_ring_start(rdev) (rdev)->asic->ring_start((rdev))
 976 #define radeon_ring_test(rdev) (rdev)->asic->ring_test((rdev))
 977 #define radeon_ring_ib_execute(rdev, ib) (rdev)->asic->ring_ib_execute((rdev), (ib))
 978 #define radeon_irq_set(rdev) (rdev)->asic->irq_set((rdev))
 979 #define radeon_irq_process(rdev) (rdev)->asic->irq_process((rdev))
 980 #define radeon_get_vblank_counter(rdev, crtc) (rdev)->asic->get_vblank_counter((rdev), (crtc))
 981 #define radeon_fence_ring_emit(rdev, fence) (rdev)->asic->fence_ring_emit((rdev), (fence))
 982 #define radeon_copy_blit(rdev, s, d, np, f) (rdev)->asic->copy_blit((rdev), (s), (d), (np), (f))
 983 #define radeon_copy_dma(rdev, s, d, np, f) (rdev)->asic->copy_dma((rdev), (s), (d), (np), (f))
 984 #define radeon_copy(rdev, s, d, np, f) (rdev)->asic->copy((rdev), (s), (d), (np), (f))
 985 #define radeon_get_engine_clock(rdev) (rdev)->asic->get_engine_clock((rdev))
 986 #define radeon_set_engine_clock(rdev, e) (rdev)->asic->set_engine_clock((rdev), (e))
 987 #define radeon_get_memory_clock(rdev) (rdev)->asic->get_memory_clock((rdev))
 988 #define radeon_set_memory_clock(rdev, e) (rdev)->asic->set_engine_clock((rdev), (e))
 989 #define radeon_set_pcie_lanes(rdev, l) (rdev)->asic->set_pcie_lanes((rdev), (l))
 990 #define radeon_set_clock_gating(rdev, e) (rdev)->asic->set_clock_gating((rdev), (e))
 991 #define radeon_set_surface_reg(rdev, r, f, p, o, s) ((rdev)->asic->set_surface_reg((rdev), (r), (f), (p), (o), (s)))
 992 #define radeon_clear_surface_reg(rdev, r) ((rdev)->asic->clear_surface_reg((rdev), (r)))
 993 #define radeon_bandwidth_update(rdev) (rdev)->asic->bandwidth_update((rdev))
 994 #define radeon_hdp_flush(rdev) (rdev)->asic->hdp_flush((rdev))
 995
 996 /* Common functions */
 997 extern int radeon_gart_table_vram_pin(struct radeon_device *rdev);
 998 extern int radeon_modeset_init(struct radeon_device *rdev);
 999 extern void radeon_modeset_fini(struct radeon_device *rdev);
1000 extern bool radeon_card_posted(struct radeon_device *rdev);
1001 extern bool radeon_boot_test_post_card(struct radeon_device *rdev);
1002 extern int radeon_clocks_init(struct radeon_device *rdev);
1003 extern void radeon_clocks_fini(struct radeon_device *rdev);
1004 extern void radeon_scratch_init(struct radeon_device *rdev);
1005 extern void radeon_surface_init(struct radeon_device *rdev);
1006 extern int radeon_cs_parser_init(struct radeon_cs_parser *p, void *data);
1007 extern void radeon_legacy_set_clock_gating(struct radeon_device *rdev, int enable);
1008 extern void radeon_atom_set_clock_gating(struct radeon_device *rdev, int enable);
1009
1010 /* r100,rv100,rs100,rv200,rs200,r200,rv250,rs300,rv280 */
1011 struct r100_mc_save {
1012         u32     GENMO_WT;
1013         u32     CRTC_EXT_CNTL;
1014         u32     CRTC_GEN_CNTL;
1015         u32     CRTC2_GEN_CNTL;
1016         u32     CUR_OFFSET;
1017         u32     CUR2_OFFSET;
1018 };
1019 extern void r100_cp_disable(struct radeon_device *rdev);
1020 extern int r100_cp_init(struct radeon_device *rdev, unsigned ring_size);
1021 extern void r100_cp_fini(struct radeon_device *rdev);
1022 extern void r100_pci_gart_tlb_flush(struct radeon_device *rdev);
1023 extern int r100_pci_gart_init(struct radeon_device *rdev);
1024 extern void r100_pci_gart_fini(struct radeon_device *rdev);
1025 extern int r100_pci_gart_enable(struct radeon_device *rdev);
1026 extern void r100_pci_gart_disable(struct radeon_device *rdev);
1027 extern int r100_pci_gart_set_page(struct radeon_device *rdev, int i, uint64_t addr);
1028 extern int r100_debugfs_mc_info_init(struct radeon_device *rdev);
1029 extern int r100_gui_wait_for_idle(struct radeon_device *rdev);
1030 extern void r100_ib_fini(struct radeon_device *rdev);
1031 extern int r100_ib_init(struct radeon_device *rdev);
1032 extern void r100_irq_disable(struct radeon_device *rdev);
1033 extern int r100_irq_set(struct radeon_device *rdev);
1034 extern void r100_mc_stop(struct radeon_device *rdev, struct r100_mc_save *save);
1035 extern void r100_mc_resume(struct radeon_device *rdev, struct r100_mc_save *save);
1036 extern void r100_vram_init_sizes(struct radeon_device *rdev);
1037 extern void r100_wb_disable(struct radeon_device *rdev);
1038 extern void r100_wb_fini(struct radeon_device *rdev);
1039 extern int r100_wb_init(struct radeon_device *rdev);
1040 extern void r100_hdp_reset(struct radeon_device *rdev);
1041 extern int r100_rb2d_reset(struct radeon_device *rdev);
1042 extern int r100_cp_reset(struct radeon_device *rdev);
1043 extern void r100_vga_render_disable(struct radeon_device *rdev);
1044 extern int r100_cs_track_check_pkt3_indx_buffer(struct radeon_cs_parser *p,
1045                                                 struct radeon_cs_packet *pkt,
1046                                                 struct radeon_object *robj);
1047 extern int r100_cs_parse_packet0(struct radeon_cs_parser *p,
1048                                 struct radeon_cs_packet *pkt,
1049                                 const unsigned *auth, unsigned n,
1050                                 radeon_packet0_check_t check);
1051 extern int r100_cs_packet_parse(struct radeon_cs_parser *p,
1052                                 struct radeon_cs_packet *pkt,
1053                                 unsigned idx);
1054 extern void r100_enable_bm(struct radeon_device *rdev);
1055
1056 /* rv200,rv250,rv280 */
1057 extern void r200_set_safe_registers(struct radeon_device *rdev);
1058
1059 /* r300,r350,rv350,rv370,rv380 */
1060 extern void r300_set_reg_safe(struct radeon_device *rdev);
1061 extern void r300_mc_program(struct radeon_device *rdev);
1062 extern void r300_vram_info(struct radeon_device *rdev);
1063 extern void r300_clock_startup(struct radeon_device *rdev);
1064 extern int r300_mc_wait_for_idle(struct radeon_device *rdev);
1065 extern int rv370_pcie_gart_init(struct radeon_device *rdev);
1066 extern void rv370_pcie_gart_fini(struct radeon_device *rdev);
1067 extern int rv370_pcie_gart_enable(struct radeon_device *rdev);
1068 extern void rv370_pcie_gart_disable(struct radeon_device *rdev);
1069
1070 /* r420,r423,rv410 */
1071 extern int r420_mc_init(struct radeon_device *rdev);
1072 extern u32 r420_mc_rreg(struct radeon_device *rdev, u32 reg);
1073 extern void r420_mc_wreg(struct radeon_device *rdev, u32 reg, u32 v);
1074 extern int r420_debugfs_pipes_info_init(struct radeon_device *rdev);
1075 extern void r420_pipes_init(struct radeon_device *rdev);
1076
1077 /* rv515 */
1078 struct rv515_mc_save {
1079         u32 d1vga_control;
1080         u32 d2vga_control;
1081         u32 vga_render_control;
1082         u32 vga_hdp_control;
1083         u32 d1crtc_control;
1084         u32 d2crtc_control;
1085 };
1086 extern void rv515_bandwidth_avivo_update(struct radeon_device *rdev);
1087 extern void rv515_vga_render_disable(struct radeon_device *rdev);
1088 extern void rv515_set_safe_registers(struct radeon_device *rdev);
1089 extern void rv515_mc_stop(struct radeon_device *rdev, struct rv515_mc_save *save);
1090 extern void rv515_mc_resume(struct radeon_device *rdev, struct rv515_mc_save *save);
1091 extern void rv515_clock_startup(struct radeon_device *rdev);
1092 extern void rv515_debugfs(struct radeon_device *rdev);
1093 extern int rv515_suspend(struct radeon_device *rdev);
1094
1095 /* rs400 */
1096 extern int rs400_gart_init(struct radeon_device *rdev);
1097 extern int rs400_gart_enable(struct radeon_device *rdev);
1098 extern void rs400_gart_adjust_size(struct radeon_device *rdev);
1099 extern void rs400_gart_disable(struct radeon_device *rdev);
1100 extern void rs400_gart_fini(struct radeon_device *rdev);
1101
1102 /* rs600 */
1103 extern void rs600_set_safe_registers(struct radeon_device *rdev);
1104 extern int rs600_irq_set(struct radeon_device *rdev);
1105 extern void rs600_irq_disable(struct radeon_device *rdev);
1106
1107 /* rs690, rs740 */
1108 extern void rs690_line_buffer_adjust(struct radeon_device *rdev,
1109                                         struct drm_display_mode *mode1,
1110                                         struct drm_display_mode *mode2);
1111
1112 /* r600, rv610, rv630, rv620, rv635, rv670, rs780, rs880 */
1113 extern bool r600_card_posted(struct radeon_device *rdev);
1114 extern void r600_cp_stop(struct radeon_device *rdev);
1115 extern void r600_ring_init(struct radeon_device *rdev, unsigned ring_size);
1116 extern int r600_cp_resume(struct radeon_device *rdev);
1117 extern int r600_count_pipe_bits(uint32_t val);
1118 extern int r600_gart_clear_page(struct radeon_device *rdev, int i);
1119 extern int r600_mc_wait_for_idle(struct radeon_device *rdev);
1120 extern int r600_pcie_gart_init(struct radeon_device *rdev);
1121 extern void r600_pcie_gart_tlb_flush(struct radeon_device *rdev);
1122 extern int r600_ib_test(struct radeon_device *rdev);
1123 extern int r600_ring_test(struct radeon_device *rdev);
1124 extern void r600_wb_fini(struct radeon_device *rdev);
1125 extern int r600_wb_enable(struct radeon_device *rdev);
1126 extern void r600_wb_disable(struct radeon_device *rdev);
1127 extern void r600_scratch_init(struct radeon_device *rdev);
1128 extern int r600_blit_init(struct radeon_device *rdev);
1129 extern void r600_blit_fini(struct radeon_device *rdev);
1130 extern int r600_init_microcode(struct radeon_device *rdev);
1131 extern int r600_gpu_reset(struct radeon_device *rdev);
1132 /* r600 irq */
1133 extern int r600_irq_init(struct radeon_device *rdev);
1134 extern void r600_irq_fini(struct radeon_device *rdev);
1135 extern void r600_ih_ring_init(struct radeon_device *rdev, unsigned ring_size);
1136 extern int r600_irq_set(struct radeon_device *rdev);
1137
1138 #endif